Tag: dma
Direct memory access (DMA) ist ein feature von modernen Computern und Mikroprozessoren, die erlaubt, dass bestimmte hardware-Subsysteme innerhalb des Computers für den Zugriff auf system-Speicher zum Lesen und/oder schreiben, unabhängig von der Zentraleinheit.
DMA memcpy Betrieb in Linux
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Möchte ich dma mit dma_async_memcpy_buf_to_buf Funktion, die in dmaengine.c-Datei (linux/drivers/dma). Für diese füge ich eine Funktion in dmatest.c-Datei (linux/drivers/dma) wie folgt: void foo () { int index = 0; dma_cookie_t cookie; size_t len = 0x20000; ktime_t start,
scatter-gather-Liste Linux-kernel-device-Treiber
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Arbeite ich an einem Gerätetreiber, der hat Zugriff auf eine scatter-gather-Liste (sg) element. Ich bin in der Lage, extrahieren Sie die Daten aus und speichern Sie es in einem zugewiesenen Puffer mit sg_copy_to_buffer. Nun, meine Idee ist,
STM32 DMA(gleichzeitige Strom -, FIFO -, burst-Modus,Doppel-Puffer)
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Den DMA für die stm32F4-Serie verfügt über einige erweiterte Funktionen, könnte ich bitte um Klärung hier? Gleichzeitige stream: Können zwei streams übertragen Daten in der gleichen Zeit? Da ein byte übertragen darf. Wenn der bus Breite 32
Speicher Ausrichtung von arrays
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Ich habe Probleme bei der Angleichung der Speicher für DMA-transfer auf den Cell-Prozessor. Ich brauche die letzten 4 bit der Adresse auf 0 ein. Ich habe 4 arrays von unsigned int wo jedes element muss ausgerichtet im
dma-vs-interrupt-driven i/o
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Bin ich ein wenig unklar über Unterschiede zwischen DMA-und interrupt-I/O. (gerade Lesen, Operating Systems Concepts, 7th ed.). Insbesondere bin ich nicht sicher, ob die interrupts, die auftreten, in jedem Fall, und an welchen Punkten ist in beiden
STM32f4 SPI-DMA erhalten
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Habe ich STM32F4407VGT6-controller on board STM32F4-Discovery. Ich versuche, Daten zu Lesen, von der AD7683 ADC mit SPI + DMA, aber der DMA-Puffer ist immer leer (alle Nullen). Im Polling-Modus funktioniert alles einwandfrei, aber ich muss Lesen eines
STM32: Umsetzung der UART im DMA-Modus
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Bin ich versucht zu implementieren UART im DMA-Modus zu übertragen-eine einfache Zeichenfolge jedes mal, wenn ein Taster gedrückt wird. So, das ich verwendet habe CubeMX um den code zu generieren und ich habe so konfiguriert UART2 TX
STM32F4 HAL DMA, UART-TX
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Ich versuche, UART übertragung funktioniert über DMA auf einen stm32f405. Dieser Teil meiner Anwendung ist entworfen, um zu senden, die aus text-strings als command-line-interface. Ich habe den RX-Teil der UART arbeitet mit DMA-Ordnung (mit 1-byte-circular DMA verarbeiten
STM32 DMA übertragung Fehler
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Benutze ich STM32F407VTG6-controller und versuchen Sie zum empfangen von Daten von SPI mit DMA. Dann möchte ich Daten zu verarbeiten, DMA Vollständige Übertragung Unterbrechen. Aber wenn die Vollständige Übertragung Interrupt ist aufgetreten ich sehe, dass TEIF (transfer-Fehler-interrupt-flag)
Die Zuteilung eine große DMA-Puffer
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Will ich weisen Sie eine große DMA-Puffer, über 40 MB in der Größe. Wenn ich dma_alloc_coherent(), es schlägt fehl, und was ich sehe, ist: ------------[ cut here ]------------ WARNING: at mm/page_alloc.c:2106 __alloc_pages_nodemask+0x1dc/0x788() Modules linked in: [<8004799c>] (unwind_backtrace+0x0/0xf8)
Direct memory access DMA - wie funktioniert das?
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Habe ich gelesen, dass wenn DMA verfügbar ist, dann Prozessor kann die route langen lese-oder Schreibanforderungen, die von disk-Blöcke, um die DMA und konzentrieren sich auf andere arbeiten. Aber, DMA, Speicher Daten - /Steuerkanal beschäftigt ist während
Wie funktioniert der DMA die Arbeit mit PCI-Express-Geräte?
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Nehmen wir an, eine CPU machen will, eine DMA-lese-transfer aus einer PCI-Express-Gerät. Die Kommunikation zum PCI-Express-Geräte wird zur Verfügung gestellt von transaction layer packets (TLP). Theoretisch ist die maximale payload-Größe ist 1024 doubleword für TLP. Also, wie
Einige Fragen, die auf dma_alloc_coherent
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Ist die DMA-Adresse aus diesem Aufruf zurückgegeben, die gleiche wie die physikalische Adresse? LDD3 sagt die DMA-Adresse behandelt werden soll als undurchsichtig durch den Fahrer. Ich möchte mmap diese DMA-Puffer auf, so dass user-space können Lesen/schreiben direkt
cache - flush und invalidate-operation
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Ich habe einige Fragen zur cache-Synchronisation Operationen. Ungültig: Bevor die cpu versucht, einen Teil des Speichers aktualisiert, die von einem Gerät, die entsprechenden Speicher muss für ungültig erklärt werden. Flush: Bevor Sie das Gerät Lesen einen Teil
PCI-Express-BAR-Speicher-mapping grundlegende Verständnis
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Ich versuche zu verstehen, wie PCI-Express, so kann ich schreiben Sie einen windows-Treiber, der Lesen und schreiben kann, um eine kundenspezifische PCI-Express-Gerät mit keine on-board-Speicher. Ich verstehe, dass die Base-Address-Register (BAR) in der PCIE configuration space halten
Linux-Kernel-Gerätetreiber zu DMA von einem Gerät in Benutzer-Speicherplatz
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Möchte ich, um Daten von einem DMA aktiviert, PCIe-hardware-Gerät in den user-space so schnell wie möglich. Q: Wie kann ich kombinieren "direct I/O zum user-space mit/und/über einen DMA-transfer" Lesen durch LDD3, es scheint, dass ich ausführen muss,
DMA-Cache-Kohärenzverwaltung
2 Antworten
Meine Frage ist: wie kann ich bestimmen, Wann es sicher ist, deaktivieren Sie den cache-snooping, wenn ich richtig mit [pci_]dma_sync_single_for_{cpu,device} in meinem Treiber? Arbeite ich an einem Gerätetreiber für ein Gerät, das schreibt direkt in RAM über
Wie man Linux-Kernel-Seitengröße programmgesteuert erhält
7 Antworten
Arbeite ich an einer Linux-Modul für IA64. Mein Aktuelles problem ist, dass der Fahrer nutzt die PAGE_SIZE und PAGE_SHIFT Makros für dma-page-Allokation. Das problem, das ich habe ist, dass die Maschine kompilieren des Treibers ist nicht die,