Tag: x86
x86 ist eine Architektur, die von der Intel 8086 CPU abgeleitet ist. Die x86-Familie umfasst die 32-Bit-Architektur IA-32 und 64-Bit x86-64 sowie 16-Bit-Legacy-Architekturen. Fragen zu letzterem sollten mit [x86-16] und / oder [emu8086] getaggt werden. Verwenden Sie das Tag [x86-64], wenn Ihre Frage für 64-Bit x86-64 spezifisch ist. Verwenden Sie für die x86-FPU das Tag [x87]. Für SSE1 / 2/3/4 / AVX * verwenden Sie auch [sse] und alle zutreffenden [avx] / [avx2] / [avx512]
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Ich bin Debuggen eine binäre Datei im gdb. Es wurde C-code kompiliert mit gcc auf einer Intel IA-32. Ich abgerufenen dieser Ausgabe von objdump. Ich bin sehr interessiert an der letzten Zeile hier: 08048d9e <func_1> 8048d9e: 55
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Ich bin wirklich wollen, Assembler zu lernen. Ich bin ziemlich gut in c/c++, aber besser verstehen will, was Los ist auf einem niedrigeren Niveau. Erkenne ich, dass die assembly im Zusammenhang in Frage gestellt, bevor, aber ich
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Las ich The Art of Assembly Language (Randall Hyde, link zu Amazon) und ich versuchte eine Konsole-Anwendung, die in jenem Buch. Es war ein Programm, das erstellt eine neue Konsole für sich selbst die Verwendung von Win32-API-Funktionen.
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Möchte ich, um die CPU-Zyklen an einem bestimmten Punkt. Ich benutze diese Funktion an diesem Punkt: static __inline__ unsigned long long rdtsc(void) { unsigned long long int x; __asm__ volatile (".byte 0x0f, 0x31" : "=A" (x)); return
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Ich wissen, wie das überschreiben einer Bibliothek mit LD_PRELOAD, zum Beispiel, wie folgt. LD_PRELOAD=./getpid.so ./testpid Nun meine Frage ist, wie man mehrere Dateien überschreiben. Sagen möchte ich überschreiben sowohl getpid und getid, wie würde ich das angeben?
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Wie vermehre vier 32-bit-Ganzzahlen, die durch weitere 4 Ganzzahlen? Ich fand keine Anweisung, die es tun können. InformationsquelleAutor der Frage Yury | 2012-05-08
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Verwendung von inline-assembler [gcc, intel, c], wie um zu prüfen, ob das carry-flag wird gesetzt, nach einer operation? InformationsquelleAutor der Frage hans | 2010-06-29
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So, wie die Frage besagt, was ist der Sinn von CS und IP-Register in die intel 8086 Fand ich diese Erklärung: Code-segment (CS) ist ein 16-bit register enthält die Adresse des 64 KB-segment mit Prozessor Anweisungen. Der
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Möchte ich zerlegen den MBR (die ersten 512 Byte) eines bootfähigen x86-Festplatte, die ich habe. Ich habe kopiert den MBR in eine Datei mit dd if=/dev/my-device of=mbr bs=512 count=1 Irgendwelche Vorschläge für ein Linux-Dienstprogramm, das zerlegen der
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Was sind einige alternativen zu der x86-Befehl call? Vielleicht so etwas wie ein Druck auf die return-Adresse, dann ein Sprung? Ist auch Ihre Mannschaft für die Ermittlung der aktuellen position im Speicher? InformationsquelleAutor der Frage rick |
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Werfen Sie einen Blick auf diese zwei Funktionen: void function1() { int x; int y; int z; int *ret; } void function2() { char buffer1[4]; char buffer2[4]; char buffer3[4]; int *ret; } Wenn ich eine Pause bei
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Als Teil eines compiler-Projekt, an dem ich zu schreiben, GNU assembler-code für x86 zu vergleichen floating-point-Werte. Ich habe versucht, Ressourcen zu finden, wie dies online und von dem, was ich verstehe, es funktioniert wie folgt: Vorausgesetzt, die
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Dem Windows-Betriebssystem, entweder 32 bit oder 64 bit. Die 64 bit version heißt Windows x64 aber die 32 bit version heißt Windows x86. Warum ist es nicht genannt Windows x32? Was ist der Grund? InformationsquelleAutor der Frage
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Ab Pentium Pro (P6-Mikroarchitektur), Intel überarbeitet, es Mikroprozessoren und der verwendeten internen RISC-Kern, der unter den alten CISC-Anweisungen. Seit dem Pentium Pro alle CISC-Anweisungen sind unterteilt in kleinere Teile (uops) und dann erfolgt durch die RISC-Kern. Am
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Den gcc -S option erzeugt Assembler-code in AT&T-syntax, gibt es eine Möglichkeit zum generieren von Dateien im Intel-syntax? Oder gibt es eine Möglichkeit das konvertieren zwischen den beiden? InformationsquelleAutor der Frage hyperlogic | 2008-10-14
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Ich bin neu mit gcc-inline-assembly, und wollte Fragen, ob, auf einem x86-multi-core-Maschine, ein spinlock (ohne race conditions) umgesetzt werden könnten (mit AT&T-syntax): spin_lock: mov 0 eax lock cmpxchg 1 [lock_addr] jnz spin_lock ret spin_unlock: lock mov 0
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Mich korrigieren, wenn ich falsch bin. Dies ist mein Verständnis von JNZ und CMP. JNZ - Der Sprung findet statt, wenn die Z - Flag NICHT null ist (1) CMP - Wenn die beiden Werte gleich sind,
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Wie verwenden Sie die springen Familie von Anweisungen? Dies ist, was Sie haben: JL label "Es" springt, wenn es weniger als oder wenn es nicht größer als oder gleich. Meine Frage ist was ist es in diesem
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Der Standard-assembly-syntax-Datei funktionierte nicht gut und die Suche im web über den gas-Montage fand ich nichts über eine gas - (AT&T) syntax-file für vim. Hat sich jemand gefunden? Ich kann nicht schreiben, meine eigene syntax-Datei. http://img168.imageshack.us/img168/46/nasm.png ft=nasm
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Könnte mir jemand erklären, was das bedeutet? (Intel-Syntax, x86, Windows) and dword ptr [ebp-4], 0 InformationsquelleAutor der Frage | 2010-06-07
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Ich weiß, die Allgemeine Theorie aber ich kann es nicht passen in die details. Ich weiß, dass ein Programm liegt in den sekundären Speicher eines Computers. Sobald das Programm mit der Ausführung beginnt, ist es vollständig kopiert,
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Ich würde gerne wissen was der Unterschied zwischen diesen Anweisungen ist: MOV AX, [TABLE-ADDR] und LEA AX, [TABLE-ADDR] InformationsquelleAutor der Frage naveen | 2009-11-09
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Mein Verständnis von Montage-Register sagen, dass jedes register kann zugegriffen werden, indem der gesamte 32-bit-code, und es ist zerbrochen in mehrere zugängliche Verzeichnisse. In diesem Beispiel EAX ein 32 bit register, wenn wir rufen AX sollte es
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Sehe ich einen großen Unterschied in der Leistung zwischen code, kompiliert in Microsoft Visual C ++ (unter Windows) oder GCC (Linux) für ein Ivy Bridge system. Der code Dichte-matrix-Multiplikation. Ich bin immer 70% der peak-flops mit GCC
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Warum ist die Größe des L1-cache kleiner ist als der L2-cache in den meisten Prozessoren ? InformationsquelleAutor der Frage Karthik Balaguru | 2011-01-12
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So weiß ich, was die folgenden Register und Ihre verwendet werden sollen: CS = Code-Segment (IP) DS = Daten-Segment (für MOV) ES = Ziel Segment (MOVS, etc.) SS = Stack Segment (SP) Aber was sind die folgenden
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Fragte ich mich immer, was ist der Zweck der rotate-Anweisungen einige CPUs haben (ROL, RCL auf x86, zum Beispiel). Welche Art von software nutzt diese Anleitung? Ich dachte zuerst, Sie können verwendet werden für die Verschlüsselung/Computer-hash-codes, aber
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Ich habe folgenden asm code: ; int __stdcall wWinMain(HINSTANCE hInstance, HINSTANCE hPrevInstance, LPWSTR lpCmdLine, int nShowCmd) _wWinMain@16 proc near var_8= dword ptr -8 var_4= dword ptr -4 hInstance= dword ptr 8 hPrevInstance= dword ptr 0Ch lpCmdLine= dword
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Ist es wahr, dass die x86-ASM "LOCK" - Befehl-Präfix bewirkt, dass alle Kerne zu frieren, während die folgende Anweisung "LOCK" ausgeführt wird? Las ich dies in einem blog-post und es macht keinen Sinn. Ich kann nichts finden,
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Ich bin versucht zu kompilieren eine visual studio-Lösung mit devenv.exe von der Befehlszeile aus. Kann ich es auf der Arbeit, aber alle Projekte in der Projektmappe kompiliert werden, für AnyCPU und ich will, dass Sie kompiliert für
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Gibt es trotzdem, diese kann getan werden? Ich habe verwendet, objdump, aber nicht produzieren assembly output akzeptiert werden von jedem assembler, die ich kenne. Ich möchte in der Lage sein zu ändern die Anweisungen in eine ausführbare
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Könnte dies vergeblich, da ich weiß, das schreiben eines Betriebssystems ist unerträglich kompliziert (vor allem durch sich selbst). Ich erwarte nicht, dass für den Bau der nächsten linux oder windows. Ich weiß, es wird schrecklich sein, und
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Ich will schreiben Sie eine kleine low-level-Programm. Für einige Teile davon werde ich brauchen, um assembly-Sprache verwenden, aber der rest des Codes geschrieben werden, die auf C/C++. So, wenn ich mit GCC zu mischen, C/C++ mit Assembler-code
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Stolperte ich kürzlich über das folgende assembly instruction sequence: rep stos dword ptr [edi] InformationsquelleAutor der Frage COMer | 2010-09-29
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Ich versuche, das Profil und die Optimierung von algorithmen und ich würde gerne verstehen, die spezifische Auswirkung der caches auf verschiedenen Prozessoren. Für aktuelle Intel x86-Prozessoren (z.B. Q9300), es ist sehr schwer zu finden, detaillierte Informationen über
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Ich versuche zu verstehen, einige Montage. Die Montage wie folgt aus, ich interessiere mich für die testl Linie: 000319df 8b4508 movl 0x08(%ebp), %eax 000319e2 8b4004 movl 0x04(%eax), %eax 000319e5 85c0 testl %eax, %eax 000319e7 7407 je 0x000319f0
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Kann mir bitte jemand erklären, was gewinnen wir durch eine separate instruction-cache und Daten-cache. Irgendwelche Hinweise, um eine gute Verbindung zu erklären, das wird auch geschätzt. InformationsquelleAutor der Frage Venom | 2012-01-03
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Ich versuche zu finden, einige Hinweise in Bezug auf die x86 Assembler Sprachen. Tutorials/Beispiele, damit mein Verständnis. -Dank InformationsquelleAutor der Frage Dacto | 2008-10-18
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Ich bin irgendwie neu in der ganzen Portierung Problem und ich habe es wegen der Langsamkeit in der emulator mit dem Android SDK. Ich heruntergeladen, die android-x86-3.2-RC2-eeepc und android-x86-3.2-RC2-tegav2 ISO-es - (aus diesem Website) und versucht, Sie
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Was bedeutet rep; nop bedeuten? Ist es das gleiche wie pause Anleitung? Ist es das gleiche wie rep nop (ohne Semikolon)? Was ist der Unterschied zu den einfachen nop Anleitung? Verhält es sich anders als auf AMD-und
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Wo finde ich die Namen der Register für die Montage auf dieser Architektur? Ich beziehe mich auf die Register im X86-wie EAX, ESP, EBX, etc. Aber ich möchte Ihnen in 64bit. Ich glaube nicht, Sie sind die
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Ich habe einige Probleme mit Bearbeiten und Fortfahren bei der Verwendung von Visual Studio 2010 auf einem Windows 7 64 bit-Maschine. Ich habe dafür gesorgt, das folgende "Bearbeiten und Fortfahren" aktiviert ist (unter Extras>Optionen>Debuggen>Bearbeiten und Fortfahren Meine
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Einmal eine Zeit, zu schreiben, x86-assembler, zum Beispiel, würden Sie haben Anweisungen, die besagt "laden Sie das EDX-register mit dem Wert 5", "erhöht die EDX" registrieren, usw. Modernen CPUs haben 4 Kerne (oder auch mehr), bei den
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Ich bin interessiert an cross-kompilieren eines Linux-Kernels für ARM-target auf einem x86-host. Gibt es einige gute Methoden, die Sie empfehlen? Welches ist das beste cross-compile-suite, deiner Meinung nach? Haben Sie sich ein eigenes cross-compile-Umgebung? Wenn ja, welche
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Dies ist die empfangene Nachricht ein Skript ausgeführt, um zu überprüfen, ob Tensorflow arbeitet: I tensorflow/stream_executor/dso_loader.cc:125] successfully opened CUDA library libcublas.so.8.0 locally I tensorflow/stream_executor/dso_loader.cc:125] successfully opened CUDA library libcudnn.so.5 locally I tensorflow/stream_executor/dso_loader.cc:125] successfully opened CUDA library libcufft.so.8.0
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Laut Wikipedia, x86 ist eine CISC-design, aber ich habe auch gehört/gelesen, dass es RISC. Was ist nun richtig? Ich würde auch gerne wissen, warum es ist CISC oder RISC. Was bestimmt, ob ein design RISC-oder CISC? Ist
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Jetzt werde ich lernen, ARM-Assembly zu entwickeln, der für mein Windows Mobile 5 iPAQ, aber ich habe einige Fragen: Was Sind Die Wichtigsten Unterschiede Zwischen ARM Montage-und x86 Assembler? Irgendwelche Unterschiede In Der Interrupts(Neue Typen)? Was Sind
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Habe ich eine 128-bit vorzeichenlose ganze Zahl A und eine 64-bit-Ganzzahl B. Was ist der Schnellste Weg zu berechnen A % B - das ist das (64-bit) Rest aus der Division von A durch B? Ich bin
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Ok, ich lese die folgenden Qs von SO zu x86-CPU-Zäune (LFENCESFENCE und MFENCE): Macht es keinen Sinn, Unterricht LFENCE in den Prozessoren x86/x86_64? Was sind die Auswirkungen SFENCE und LFENCE caches der benachbarten Kerne? Ist das MESI-Protokoll
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Wie bestimmen Sie 32-oder 64-bit-Architektur von Windows, die mit Java? Dank. InformationsquelleAutor der Frage Matthew | 2009-12-06